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TITOLO: Sistema di lettura e scrittura in Ram
SCOPO:
Realizzazione di un sistema di scrittura e lettura in RAM con visualizzazione separate 646f52g dell'indirizzo e del dato. Limitazione: al fine di non rendere troppo complicato il circuito e realizzare la visualizzazione con un solo decoder pi display, si limiteranno a 4 bit sia per gli indirizzi che per i dati scrivere in memoria; sar cos possibile indirizzare 16 posizioni di memoria e visualizzare 0:15 in esadecimale.
CENNI TEORICI:
La resistenza la propriet di un componente elettrico di opporsi al passaggio di corrente elettrica. L'unit di misura della resistenza l'ohm.
La memoria RAM una
memoria a modalit di programmazione una memoria ad accesso casuale. Una qualsiasi
locazione (cella) individuata da un numero (indirizzo) e il suo contenuto pu essere letto o modificato in un intervallo di tempo
costate detto tempo di accesso.
Il Write lo strumento che ci serve per scrivere in memoria le cose che bisogna salvare.
I Bus Dati l'insieme delle linee che trasmettono dati.
I Bus Indirizzi l'insieme delle linee che trasmettono gli indirizzi e si pu indicare con Address Bus.
Il generatore ci serve ad dare corrente a tutto il sistema.
La porta logica NOT serve come negazione; per cambiare gli ingressi.
Il Display un dispositivo in cui sono integrati 7 diodi LED (8 se si considera anche il punto) corrispondenti a segmenti e assemblati come mostro sotto; ciascuno dei segmenti ha la propria lettera di identificazione, mostrata sotto.
Il Decoder un dispositivo digitale che riceve in ingresso un codice binario e attiva una sola linea di uscita, quella corrispondente al codice presente in ingresso.
I Data Register o Registro dati, il loro compito collegare
Il Address Latch serve ad indirizzare il Latch.
SCHEMA GRAFICO INIZIALE:
SCHEMA GRAFICO:
MATERIALE UTILIZZATO:
- La memoria RAM 6264, dotata di 3 abilitazioni.
E1 negato attivo basso
E2 negato attivo alto
G negato attivo basso
Il comando di scrittura W negato attivo basso
- L' Address Latch;
Enable in ingresso attivo alto, enable di uscita attivo basso
- Il NOT, Cio la negazione
- Il Display, Display 507/567 Enable attivi alti.
- Il Decoder, decoder BCD 7 segmenti (74LS47) che pu essere anche sostituito dal CI 9368
- Il Data Register, Enable attivi alti
-Resistenza da 1 K.
FUNZIONAMENTO:
Descrizione del funzionamento
I bus di ingresso possono rappresentare il dato o l'indirizzo a seconda del segnale che viene dato;
I display visualizzano sempre il dato e l'indirizzo presente sul bus;
La memoria sempre abilitata, G negato 0;
Lettura dell'indirizzo in memoria:
Il segnale di WRITE non deve essere abilitato(segnale 1). Il LATCH riservato agli indirizzi abilitato.
L'altro LATCH, quello riservato ai dati, disabilitato sia in ingresso che in uscita;
Scrittura in memoria nell'indirizzo selezionato
Viene abilitato il segnale di WRITE (segnale 0).
Il LATCH degli indirizzi viene disabilitato, ma lascia sul bus indirizzi l'indirizzo precedente (dato precedentemente in lettura);
Il LATCH dei dati abilitato sia in ingresso che in uscita e pone sul bus dati il dato selezionato con i bit di ingresso;
Lettura del dato in memoria:
Viene disabilitato il segnale di WRITE (segnale 1).
Per poter leggere il dato inserito in un certo indirizzo selezionare sui bit di ingresso l'indirizzo desiderato;
Sul display degli indirizzi verra' visualizzato l'indirizzo selezionato mentre sul display dei dati apparira' il dato inserito in quell''indirizzo
ES:
-LETTURA INDIRIZZO:
Disabilito segnale WRITE
Inserisco l'indirizzo: 1000 : indirizzo 1
-SCRITTURA DEI DATI IN MEMORIA:
Abilito il segnale di WRITE
Inserisco il dato da scrivere: 1100 : dato 3
-LETTURA DEL DATO INSERITO:
Disabilito il segnale di WRITE
Inserisco l'indirizzo inserito precedentemente: 1000 : 1
Visualizzera' cosi' sul display degli indirizzi 1 e su quello dei dati 3
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